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产品名称：	2098-DSD-010X-DN /C
浏览量：	0
价格：	66
供货总量：	55
规格：	2098-DSD-010X-DN /C
更新日期：	2018年12月26日，有效期：360天
关键字：	2098DSD010XD 2098DSD010XD 2098DSD010XD
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2098-DSD-010X-DN/C

2098-DSD-010X-DN/C 在该设计中，FPGA的数据通道采用FPDP总线结构，分别与A／D板、DSP板相连，进行实时高速数据传输。A／D板负责对回波信号进行高速采集，DSP板接收FPGA发送过来的合成数据进行后期处理。FPDP接收模块负责接收来自A／D板的原始回波数据，FPDP发送模块负责把原始回波数据及其他飞机参数打包并以FPDP协议的形式发送给DSP板。如图1所示。

A／D板与DSP板的数据接口均为FPDP总线结构，发送方式为单帧模式。对于单帧数据传输模式，同步信号SY应该先于个发送的数据，此时数据有效信号(DVALIDn)仍为高，指示数据无效。在进行数据传输时，将DVALIDn信号有效，在时钟STROB(或PSTROBE)上升沿的同步下将发送数据驱动到FPDP的数据总线上。在时钟STROB(或PSTROBE)上升沿，接收设备对D[31．．0]和DVALIDn信号进行采样。若DVALIDn为低，则认为发送过来的数据是有效的。单帧数据传输波形图，如图2所示。

为了满足信号处理机实时处理的要求，要求输入到DSP板的原始数据符合处理的数据格式。而采集到的数据需按一定格式打包，称为数据合成。FPGA要将来自不同设备的数据合成为所需的帧格式后转发到DSP板。这样，DSP板在获得数据帧后就可以直接进行处理而不必再有格式转换的开销。其原理图，如图3所示。

2098-DSD-010X-DN/C 由于FPDP总线传输实时性要求很强，在传输过程中不允许数据丢失，具有数据量大、传输速度高等特点。因此，FPDP接收逻辑应在接收到原始回波数据后，尽快发送给DSP板。否则，将造成数据堵塞、丢失及紊乱，严重影响后端的成像处理，因此在FPDP总线收发逻辑之间引入一个数据缓冲区FIFO，暂存原始回波数据。

FPDP接收逻辑接收来自A／D板的回波数据，主要负责对数据缓冲区FIFO的写入操作。其工作流程如下：在FPDP总线数据有效(DVALIDn为低)时，FIFO的写请求Wr-req信号有效，此时数据随着写时钟信号(Wr-clk即AD板发送过来的Ad-strob信号)写入FIFO。若FPDP总线数据无效，此时FIFO的写请求信号也无效，数据不能写入FIFO。

　　FPDP发送逻辑接负责将回波数据和其他飞机参数按照一定的格式打包，并经由FPDP总线发送出去。其工作流程如下：FIFO的读请求Rd-req信号由发送时序计数器产生，当计数器的计数值为一定值(A／D采集满一帧数据)时，Rd-req有效，随着读时钟(Rd-clk即A／D板时钟AD_strob)信号，数据从FIFO中读出，此时计数器清零。数据按一定格式打包后，按FPDP单帧传输模式将打包数据送入DSP板。

FPDP发送逻辑应当在FPDP同步信号SY到来后立即启动数据发送，这样大大增强了数据传输的实时性和可靠性。值得注意的是，A／D板传来的组回波数据来不及打包传送给DSP板，因此要在FIFO中累积一组回波数据后再开始往DSP板发送数据，这样每次发给DSP板的一帧数据中，回波数据应为上一次A／D板发来的数据，这样可以保证不丢失回波数据，只是一组回波数据仍然会存在于时序板中，采集不到，应当丢弃。

特别地，由于模块的输入输出功能已确定，所以作为A／D板接收端的方向信号DIRn不被使用，而作为DSP板发送端的DIRn信号则常接低。对于输入的PENDn和NRDYn信号，A／D采集板对NRDYn信号不响应，所以FPGA对这两个信号也不响应，避免干扰AD采集板的数据采集。